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?利用晶體振蕩器理解變?nèi)莨芎突赑LL的調(diào)頻生成

在這篇文章中，我們研究了產(chǎn)生寬帶調(diào)頻信號的兩種不同方法。兩者都使用晶體振蕩器來提供改進的頻率穩(wěn)定性。多年來，已經(jīng)開發(fā)了許多不同的電路來產(chǎn)生FM信號。在之前的文章中，我們了解了如何利用電抗調(diào)制器和變?nèi)荻O管使LC振蕩器可調(diào)...

晶體振蕩器變?nèi)莨?/a> 2025-09-29

Arteris推出升級版Multi-Die 解決方案，加速AI驅(qū)動芯片創(chuàng)新

加利福尼亞州坎貝爾—2025 年 6 月 17 日—在人工智能計算需求重塑市場格局之際，致力于加速系統(tǒng)級芯片 (SoC) 開發(fā)的領(lǐng)先系統(tǒng) IP 提供商 Arteris 公司（納斯達克股票代碼：AIP）今天宣布擴展其 Mu...

Arteris Multi-Die 2025-06-19

基于onsemi NCP1618多模式PFC 500W設(shè)計方案

近年來隨著應(yīng)用技術(shù)不斷推陳出新，造就終端應(yīng)用的功率需求越來越大，例如:5G網(wǎng)通電源供應(yīng)器、ATX/Gaming電源供應(yīng)器等等，功率消耗大于一程度時電源供應(yīng)器就要有功率因數(shù)校正(Power Factor Cor...

onsemi power 2023-10-11

從概念到關(guān)鍵指標，一文弄清PLL頻率合成器那些事

因鎖相環(huán)可以實現(xiàn)輸出信號頻率對輸入信號頻率的自動跟蹤，所以鎖相環(huán)通常用于閉環(huán)跟蹤電路。鎖相環(huán)在工作的過程中，當輸出信號的頻率與輸入信號的頻率相等時，輸出電壓與輸入電壓保持固定的相位差值，即輸出電壓與輸入電壓的相位被鎖住，...

PLL 2023-02-02

羅德與施瓦茨率先推出CTIA授權(quán)的支持多到達角功能的5G FR2毫米波測試系統(tǒng)

羅德與施瓦茨公司與美國CTIA協(xié)會合作，研發(fā)并認證了截至目前業(yè)內(nèi)首套具有多到達角度功能（multi-AoA）的測試系統(tǒng)，該系統(tǒng)將用于CTIA 的OTA性能認證測試。該解決方案以一致性測試系統(tǒng)R&S TS8980為...

羅德與施瓦茨 CTIA 2022-10-11

微波頻率合成器提供多倍頻程覆蓋范圍和出色的相位噪聲性能

簡介市場對更高帶寬和更高數(shù)據(jù)速率的需求日益增加，系統(tǒng)頻率和調(diào)制速率要求不斷提高。隨著曾經(jīng)用于軍事和國防領(lǐng)域的應(yīng)用進入消費市場，低功耗變得至關(guān)重要。在滿足這些要求的同時，還需要保證：不會犧牲電氣性能或功能。為了滿足這些要求...

SNR LO 2020-10-13

驅(qū)動高壓鎖相環(huán)頻率合成器電路的VCO

鎖相環(huán)(PLL)電路是由壓控振蕩器(VCO)和鑒相器組成的反饋系統(tǒng)，振蕩器信號跟蹤施加的頻率或相位調(diào)制信號是否具有正確的頻率和相位。需要從固定低頻率信號生成穩(wěn)定的高輸出頻率時，或者需要頻率快速變化時，都可以使用PLL。典...

VCO PLL 2020-09-17

微電網(wǎng)模擬系統(tǒng)

系統(tǒng)采用三相半橋拓撲，以STM32F407ZET6單片機為主從控制器，主控制器在dq坐標下進行控制實現(xiàn)三相穩(wěn)壓輸出，從控制器采用主從均流控制實現(xiàn)兩臺三相逆變器的電流分配，采用三相同步鎖相環(huán)(SRP-PLL)。逆變器單獨工...

三相逆變器主從均流 2018-08-27

PLL設(shè)計注意事項----之電源設(shè)計

PLL(Phase Locked Loop)：為鎖相回路或鎖相環(huán),用來統(tǒng)一整合時脈訊號,使內(nèi)存能正確的存取資料。PLL用于振蕩器中的反饋技術(shù)。鎖相環(huán)通常由鑒相器(PD)、...

PLL 振蕩器 2018-08-24

如何確保頻率的準確測量

　　功率分析儀在測試時出現(xiàn)的數(shù)據(jù)跳動、效率異常等現(xiàn)象，很多時候與信號的頻率是否準確測量有著很大的關(guān)系，本文就對頻率測量的重要性進行分析，希望能幫助大家進行更準確的測量。　　首先我們來看看為什么頻率的測量對其他參數(shù)會造成如...

PLL 頻率 2018-06-22

常用射頻模塊電路推薦布局方案

　　1 頻綜布局　　單頻綜布局。通常采取如圖形狀進行布局：左臂支為參考頻率源及鎖相環(huán)控制電路，右臂支為壓控制振蕩器(VCO)輸出隔離放大電路。中部環(huán)狀為鎖相環(huán)(PLL)　　乒乓切換式頻綜布局，又叫音叉式布局：音叉的兩臂為...

射頻 PLL 2018-05-22

FPGA學習：PLL分頻計數(shù)的LED閃爍實例

　　如圖8.17所示，本實例將用到FPGA內(nèi)部的PLL資源，輸入FPGA引腳上的25MHz時鐘，配置PLL使其輸出4路分別為12.5MHz、25MHz、50MHz和100MHz的時鐘信號，這4路時鐘信號又分別驅(qū)動4個不同...

FPGA PLL 2018-04-27

希捷發(fā)布Multi-Actuator多讀寫臂技術(shù)：提高讀寫性能

　　隨著大數(shù)據(jù)云計算的發(fā)展需求，大規(guī)模數(shù)據(jù)中心不僅對于硬盤容量的需求日增，對于硬盤讀寫性能的需求更為迫切。為了緩解這些壓力，希捷Seagate發(fā)布了全新Multi-Actuator多讀寫臂電機技術(shù)，通過兩組磁頭獨立讀寫的...

希捷 Multi-Actuator 2017-12-28

寬帶低誤差矢量幅度(EVM)直接變頻發(fā)射機原理圖

寬帶低誤差矢量幅度(EVM)直接變頻發(fā)射機原理圖-本電路為寬帶直接變頻發(fā)射機模擬部分的完整實現(xiàn)方案（模擬基帶輸入、RF輸出）。通過使用鎖相環(huán)（PLL）和寬帶集成電壓控制振蕩器（VCO），本電路支持500 MHz至4.4 ...

VCO PLL 2017-10-31

利用可編程振蕩器增強FPGA應(yīng)用

利用可編程振蕩器增強FPGA應(yīng)用-可編程時鐘振蕩器用作FPGA系統(tǒng)的時序參考，可提供一系列優(yōu)勢。其中首要優(yōu)勢是為了實現(xiàn)時鐘樹優(yōu)化而進行高分辨率頻率選擇時所帶來的設(shè)計靈活性，另一個巨大優(yōu)勢是具有可以減少電磁干擾（EMI）的...

DLL PLL 2017-10-21

PLL和DLL：都是鎖相環(huán)，區(qū)別在哪里？

PLL和DLL：都是鎖相環(huán)，區(qū)別在哪里？-一般在altera公司的產(chǎn)品上出現(xiàn)PLL的多，而xilinux公司的產(chǎn)品則更多的是DLL，開始本人也以為是兩個公司的不同說法而已，后來在論壇上見到有人在問兩者的不同，細看下，原來...

鎖相環(huán) DLL 2017-10-13

PLL鎖相環(huán)的特性、應(yīng)用與其基本工作過程

PLL鎖相環(huán)的特性、應(yīng)用與其基本工作過程-PLL（Phase Locked Loop），也稱為鎖相環(huán)路（PLL）或鎖相環(huán)，它能使受控振蕩器的頻率和相位均與輸入?yún)⒖夹盘柋３滞剑Q為相位鎖定，簡稱鎖相。...

pll 鎖相環(huán) 2017-10-11

PLL鎖相環(huán)的基本結(jié)構(gòu)及工作原理

PLL鎖相環(huán)的基本結(jié)構(gòu)及工作原理-PLL（Phase Locked Loop）：為鎖相回路或鎖相環(huán)，用來統(tǒng)一整合時脈訊號，使高頻器件正常工作，如內(nèi)存的存取資料等。PLL用于振蕩器中的反饋技術(shù)。許多電子設(shè)備要正常工作，...

pll 鎖相環(huán) 2017-10-11

如何滿足復(fù)雜系統(tǒng)的高性能時序需求

　　時鐘設(shè)備設(shè)計使用 I2C 可編程小數(shù)鎖相環(huán) (PLL)，可滿足高性能時序需求，這樣可以產(chǎn)生零 PPM(百萬分之一)合成誤差的頻率。高性能時鐘 IC 具有多個...

I2C PLL 2017-08-23

信號鏈基礎(chǔ)知識#54 誰是音頻時鐘的“老板”，誰是主，誰又是從呢？

如果轉(zhuǎn)換器為一個 I2S 從器件，則您必須通過相同源（如果轉(zhuǎn)換器帶有，則可以依靠內(nèi)部 PLL），提供所有三個 I2S 時鐘（MCK、BCK 和 LRCK）。...

I2S DSP 2017-06-03

如何根據(jù)數(shù)據(jù)表規(guī)格算出鎖相環(huán)（PLL）中的相位噪聲

　　也許你也會跟我一樣認為典型數(shù)據(jù)表中的某些規(guī)格難以理解，這是因為其中涵蓋了一些你不太熟悉的隱含慣例。對許多RF系統(tǒng)工程師而言，其中一種規(guī)格便是鎖相環(huán)(PLL)中的相位噪聲。當信號源被用作本機振蕩器(LO)或高速時鐘時，...

PLL VCO 2017-05-09

PLL回路濾波器設(shè)計的調(diào)整指南

　　假設(shè)您已經(jīng)通過迭代信息傳遞相位邊限和回路帶寬在鎖相環(huán)(PLL)上花費了一些時間。但遺憾地是，還是無法在相位噪聲、雜散和鎖定時間之間達成良好的平衡。感到泄氣?想要放棄?等一下!你是否試過伽馬優(yōu)化參數(shù)?　　伽馬優(yōu)化參數(shù)　...

PLL 回路濾波器 2017-03-17

PLL回路濾波器設(shè)計的調(diào)整指南

PLL 濾波器 2017-03-08

【E問E答】模擬鎖相環(huán)電路鎖定檢測問題解答

　　模擬鎖相環(huán)電路鎖定檢測問題解答　　1.PLL鎖定有那些檢測方法，它們特點是什么?　　一種是最為簡單的數(shù)字檢測，它利用輸入?yún)⒖嫉姆诸l信號與VCO反饋的分頻信號，在PFD里鑒相的結(jié)果，通過連續(xù)結(jié)果時鐘周期檢測到鑒相的脈寬...

鎖相環(huán) PLL 2016-12-02

PLL振蕩電路圖

PLL振蕩電路圖...

PLL 振蕩電路 2016-11-12

PLL陷波濾波器可以用于阻攔不需要的頻率

經(jīng)常有要阻擋某些頻率信號的情況，其中最常見的是50Hz或60Hz的電力線工頻。圖1中的PLL陷波濾波器可以用于阻攔不需要的頻率。IC1LM567C是一只音調(diào)解碼器。C1、R1A和R1B等元件決定了IC1探測的頻率F：F=...

PLL 陷波濾波器 2016-11-07

雙環(huán)路時鐘發(fā)生器可清除抖動并提供多個高頻輸出

隨著數(shù)據(jù)轉(zhuǎn)換器的速度和分辨率不斷提升，對具有更低相位噪聲的更高頻率采樣時鐘源的需求也在不斷增長。時鐘輸入面臨的積分相位噪聲(抖動)是設(shè)計師在設(shè)計蜂窩基站、軍用雷達系統(tǒng)和要求高速和高性能時鐘信號的其他設(shè)計...

PLL 雙環(huán)路 2016-10-29

選擇你的PLL鎖定時間測量

時鐘速度的提高和更嚴格的信號時序增加了對精準的高頻模塊的需求。PLL(鎖相環(huán))基于輸入信號生成高頻輸出信號，是一種備受歡迎的用于產(chǎn)生高頻信號的電路。當PLL參考時鐘和PLL反饋時鐘的頻率和相位相匹配時，PLL則被稱...

PLL 時間測量 2016-10-22

定時決定一切：如何使用部分 PLL 創(chuàng)建調(diào)制波形

我們可能都見到過需要隨時間變化掃描頻率的情況。如果您遇到這樣的問題，可以考慮雷達等應(yīng)用，在這類應(yīng)用中發(fā)送的信號不僅可由目標反射回來，而且還能夠與接收到的信號進行比較，如下圖 1 所示。觀察頻率 (Df) 差異...

PLL 調(diào)制波形 2016-10-16

用于PLL/VCO和時鐘IC供電的超低噪聲線性調(diào)節(jié)器

寬帶通信系統(tǒng)通常需要超低噪聲調(diào)節(jié)器來為VCO和PLL供電。調(diào)節(jié)器還必須能夠抑制其輸入端出現(xiàn)的任何紋波。在一般系統(tǒng)中，交流輸入轉(zhuǎn)換為隔離式直流供電軌，例如-48 V直流。該供電軌繼而轉(zhuǎn)換為隔離式12 V系統(tǒng)軌，為通信...

超低噪聲調(diào)節(jié)器 PLL 2016-10-16

如何為你的定時應(yīng)用選擇合適的基于PLL的振蕩器

十幾年前，頻率控制行業(yè)推出了基于鎖相環(huán)(PLL)的振蕩器，這是一項開拓性創(chuàng)新技術(shù)，采用了傳統(tǒng)晶體振蕩器(XO)所沒有的多項特性。憑借內(nèi)部時鐘合成器IC技術(shù)，基于PLL的XO可編程來支持更寬廣的頻率范圍。這一突破消除了...

鎖相環(huán) PLL 2016-10-15

基于ADIsimPLL 3．1的鎖相環(huán)環(huán)路濾波器設(shè)計

對鎖相環(huán)環(huán)路濾波器進行簡單分析，對ADIsimPLL 3．1模擬軟件的功能特點做了簡要介紹，并利用仿真軟件對一款頻率合成器的環(huán)路濾波器進行仿真設(shè)計，結(jié)果表明該軟件在設(shè)計應(yīng)用中方便快捷，能夠幫助設(shè)計出滿足指標要求且性能穩(wěn)定...

環(huán)路帶寬 PLL 2016-10-10

鎖相環(huán)無法鎖定，就該這樣處理

　　在嘗試將鎖相環(huán)(PLL)鎖定時，你是否碰到過麻煩?草率的判斷會延長調(diào)試過程，調(diào)試過程變得更加單調(diào)乏味。根據(jù)以下驗證通行與建立鎖定的程序，調(diào)試過程可以變得非常簡單。　　第1步：驗證通信　　第一步是驗證PLL響應(yīng)...

鎖相環(huán) PLL 2016-09-12

【E問】鎖相環(huán)的組成和工作原理介紹

　　1.鎖相環(huán)的基本組成　　許多電子設(shè)備要正常工作，通常需要外部的輸入信號與內(nèi)部的振蕩信號同步，利用鎖相環(huán)路就可以實現(xiàn)這個目的。　　鎖相環(huán)路是一種反饋控制電路，簡稱鎖相環(huán)(PLL)。鎖相環(huán)的特點是：利用外部輸入的...

鎖相環(huán) PLL 2016-05-19

使用具有精密相位控制的超寬帶PLL/VCO替代YIG調(diào)諧振蕩器硅片

　　RF和微波儀器(比如信號和網(wǎng)絡(luò)分析儀)需使用寬帶掃頻信號來進行大多數(shù)基本測量。但寬帶壓控振蕩器(VCO)通常會因最大限度擴大調(diào)諧范圍所需的低Q和高KVCO(VCO的調(diào)諧靈敏度，單位：MHz/V)而具有最糟...

PLL VCO 2016-04-28

用于高頻接收器和發(fā)射器的鎖相環(huán)-第一部分

　　第一部分將重點介紹有關(guān)PLL的基本概念，同時描述基本PLL架構(gòu)和工作原理，另外，我們還將舉例說明PLL在通信系統(tǒng)中的用途。最后，我們將展示一種運用ADF4111頻率合成器和VCO190-902T電壓控制振蕩器的實用P...

PLL 發(fā)射器 2016-04-28

基于RFFC2071的變頻器設(shè)計

　　?目的　　結(jié)合 RFMD公司最新的高集成度 ,高線性 IC RFFC2071(包括寬帶 VCO, PLL和淚頻器)以及其他各類器件產(chǎn)品，為客戶提供最優(yōu)設(shè)計方...

VCO PLL 2016-02-25

ADI公司集成VCO的PLL頻率合成器改善基站性能和無線服務(wù)質(zhì)量

　　Analog Devices, Inc.，全球領(lǐng)先的高性能信號處理解決方案供應(yīng)商，最近推出一款集成壓控振蕩器(VCO)的鎖相環(huán)(PLL)頻率合成器ADF4355，移動網(wǎng)絡(luò)運營商利用它可改善蜂窩基站...

ADI PLL 2016-01-27

系統(tǒng)時鐘源的比較選擇及高性能PLL的發(fā)展趨勢

　　本文分析了晶振模塊和PLL合成器這兩種主要的系統(tǒng)時鐘源的特點，并重點闡述了PLL合成器相對于晶振模塊的替代優(yōu)勢。　　在所有電子系統(tǒng)中，時鐘相當于心臟，時鐘的性能和穩(wěn)定性直接決定著整個系統(tǒng)的性能。典型的系統(tǒng)時序時鐘...

PLL 晶振 2016-01-19

改善分數(shù)分頻鎖相環(huán)合成器中的整數(shù)邊界雜散狀況

　　您曾設(shè)計過具有分數(shù)頻率合成器的鎖相環(huán)(PLL)嗎?這種合成器在整數(shù)通道上看起來很棒，但在只稍微偏離這些整數(shù)通道的頻率點上雜散就會變得高很多，是吧?如果是這樣的話，您就已經(jīng)遇到過整數(shù)邊界雜散現(xiàn)象了 —&md...

VCO PLL 2015-10-27

Multi-PLL