- 引言(混合信號FPGA控制多電平系統的電壓攀升率)：隨著工藝尺度不斷縮小，器件常常需要多個電源。為了減小功耗和最大限度地提高性能，器件的核心部分一般趨向于在低電壓下工作。為了與傳統的器件接口，或與現有的I/O標
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FPGA 功率管理 混合信號 控制電壓
- 摘要：分析了MV-D1024E系列高幀頻CMOS相機的工作時序和參數，闡述了CAMERA-LINK接口協議，并對高速數據流的存儲與處理機制進行分析，利用FPGA實現了相機的數據接口和控制，并設計靈活的USB接口，利用PC機作為參數輸入
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FPGA 1024 MV-D 相機的
- 電腦繡花機是隨著計算機技術、電子技術、機械加工技術的應用發展而不斷發展起來的光、機、電一體化設備。嵌入式系統的發展及研究風頭正勁，其在數字機床、智能控制等方面的應用正逐漸改變著傳統的工業生產和服務方
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FPGA ARM 電腦繡花機 控制系統
- 隨著工藝節點和裸片尺寸不斷縮小，采用倒裝芯片封裝IC器件的消費電子產品的數量日益增加。但是，倒裝芯片封...
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SoC 設計 封裝協同 芯片 FPGA
- 韓國政府16日宣布，韓國三星電子公司和現代汽車公司將聯合開發用于經濟型智能汽車的高級芯片。
韓國知識經濟部說，三星和現代兩家公司此舉將推動系統級芯片(SOC)的研發，該芯片是節能型汽車的主要部件。
截至2010年8月，總計200億韓元(1美元約合1295韓元)的投資將被用于開發智能鑰匙、自動停車系統和電池感應芯片，其中韓國政府將負擔90億韓元。知識經濟部一位官員表示，如果一切按計劃順利進行，到2012年韓國將實現國產系統級芯片的量產。
韓國目前一直依靠進口系統級芯片滿足市場需求。作為
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三星 SOC 電池感應芯片
- 為影像、音頻、視頻和因特網連接應用提供創新性半導體解決方案的領先供應商科勝訊系統公司宣布按計劃推出面向日益增長的“網絡”數碼相框和互動顯示設備(IDA)市場的最新 SoC 系列首款產品，該系列產品集成了互聯網連接與觸摸屏技術。高性能 CX92735 支持的先進功能包括流媒體內容、帶有幻燈放映功能及 Wi-Fi®、Bluetooth®、以太網連接等的 MP3 音頻播放等。
科勝訊系統公司總裁 Christian Scherp 表示：“科勝訊是
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科勝訊 SoC IDA 數碼相框 觸摸屏 CX92735
- 發展國內硅知識產權，首先要重視高端通用IP核研發、驗證與評估。
SoC實現的重要途徑是復用高質量的成熟IP。而IP設計和驗證是高質量IP開發流程中兩個不可或缺的部分。應該看到，由于國內IP供應商在產品和技術上不夠成熟，國外有成熟產品的IP供應商難以提供全面的本地技術支持等因素，SoC設計者和IP開發者都提出IP核評測的迫切需求。尤其是隨著工藝的不斷進步及IP復雜度的不斷提高，IP設計和驗證也面臨著越來越多的挑戰。所以，根據SoC/IP系統的特點，提高驗證的效率和驗證的可重用性，創建新的驗證解決方
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IC設計 SoC IP核 集成電路
- 高性能系統設計師在滿足關鍵時序余量的同時要力爭獲得更高性能，而存儲器>存儲器接口設計則是一項艱巨挑戰。雙倍數據速率SDRAM和4倍數據速率SDRAM都采用源同步接口來把數據和時鐘(或選通脈沖)由發射器
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FPGA 助力 存儲器 接口設計
- 前言 隨著科技的發展，信號處理系統不僅要求多功能、高性能，而且要求信號處理系統的開發、生產周期短，可編程式專用處理器無疑是實現此目的的最好途徑。可編程專用處理器可分為松耦合式(協處理器方式，即MCU
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LEON3 Speed SoC 處理器
- 摘要：現代通信系統中，數字化已成為發展的必然趨勢，數字信號處理則是數字系統中的重要環節。在數字信號處理方面提出一種級聯信號處理器的FPGA實現方案，用以取代昂貴的專用數字處理芯片。首先對級聯信號處理器做了
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FPGA 級聯 信號處理器
- 先進的視頻編碼(AVC)正在慢慢地超越數字視頻的主要標準。也稱之為H.264和MPEG-4part10，其AVC編碼在1Mbit/s~2...
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視頻編碼器 AVC編碼 FPGA
- 數字信號處理模塊是接收機系統的核心部分，系統要求數字信號處理模塊能實時處理ADC變換后的數字信號，并用軟件的方法來實現大量的無線電功能，這些功能包括：多通道校準、編解碼、調制解調、濾波、同步、盲均衡、
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FPGA 多通道 校準 算法
- 摘要：提出一種基于DSP和FPGA技術的低信噪比情況下雷達信號檢測技術的工作原理與硬件實現方法，采用數字化的處理方法處理信息，取代傳統使用的模擬檢測技術，并對實現的檢測方法和關鍵算法做了詳細介紹。
關鍵詞：高
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FPGA DSP 低信噪比 雷達信號
- 對于FFT而言，很多領域都提出了其高速實時運算的要求。利用FFT IP核實現FFT算法，并在cycloneⅡ系列的EP2C70F896C8器件上設計出處理速度為69.58 MHz的24位512點復數FFT處理器需29.3 μs，該方法具有效率高、速度快、周期短、靈活性強等特點。仿真結果表明此方法具有良好性能。
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FPGA FFT IP核
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