- FPGA單芯片四核二乘二取二的安全系統,引 言
二乘二取二系統的兩套計算機系統各有兩個CPU，并且所有結構和配件完全相同。兩套系統之間采取雙機熱備份，大幅提高了系統可靠性，在一些領域得到了廣泛應用。基于二乘二取二容錯結構的計算機聯鎖系統在國
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系統 安全 單芯片 FPGA
- 1.引言
FPGA器件結合了 ASIC的高性能和微處理器的靈活，不僅擁有豐富的邏輯資源，而且可以進行方便靈活的配置。主動配置方式盡管配置速度快、實現簡單，但并未發揮 FPGA配置靈活的特點，適合于 FPGA用作單一應用的場
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SelectMap FPGA USB 接口
- 在通信系統中分析計算系統抗噪聲性能時，經常假定信道噪聲為加性高斯型白噪聲(AGWN)。本文就是通過分析AG...
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FPGA AGWN 信號生成器
- 0 引 言
數據采集和控制系統是對生產過程或科學實驗中各種物理量進行實時采集、測試和反饋控制的閉環控制，它在工業控制、軍事電子設備、醫學監護等許多領域發揮著重要作用。其中，數據采集部分尤為重要，而傳統
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FPGA 數據 采集控制 模塊設計
- 0 引 言
數字信號處理主要研究采用數字序列或符號序列表示信號，并用數字計算方法對這些序列進行處理，以便把信號變換成符合某種需要的形式。在現代數字信號處理中，最常用的變換方法就是離散傅里葉變換(DFT)，
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FPGA FFT 級聯 處理器
- 基于改進型二步索引算法OSD電路的FPGA實現, 0 引 言 OSD(on screen display)，即在屏顯示系統，是實現人機界面交互的基礎，在視頻處理SOC中作為重要功能模塊有著廣泛的應用。 基于SOC技術的模塊化設計要求各功能模塊盡可能小地占用電路資源，以滿足芯片系統
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電路 FPGA 實現 OSD 算法 改進型 索引 基于 FPGA
- 基于ARM芯片S3C2410的TFT-LCD驅動方法,S3C2410是三星公司生產的基于ARM920T內核的RISC微處理器,主頻率可達203MHz,適用于信息家電、Smart Phone、Tablet、手持設備、移動終端等領域。其中,集成的LCD控制器具有通用性,可與大多數的LCD顯示模塊接口。 PD
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驅動 方法 TFT-LCD S3C2410 ARM 芯片 基于 ARM
- 引 言 車輛在公路上應以與路況相符的速度行駛，太快了易出事故, 太慢了將成為后續車輛的絆腳石。但是，常有個別司機不按規定的速度行駛而違章，導致事故頻生。交管部門為了取證糾違, 目前多采用雷達測速系統（利
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ARM 紅外光汽車 管理系統 速度
- O引言作戰系統時間的統一同步(時統)的重要性越來越得到重視，只有保證整個系統處在同一時間的基準...
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FPGA 作戰系統 時統
- 0 引言 隨著微電子和信息技術的快速發展，以單片機為代表的數字技術發展日新月異。單片機由于具有體積小、功耗低、控制功能強、擴展靈活、微型化和使用方便等優點，而廣泛應用于各種儀表的控制，計算機的網絡通訊
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分析儀 設計 音頻 LPC2148 ARM 單片機 基于
- 我真的需要那種技術嗎?我現在應該購買嗎?如果我不購買，是不是就會處于劣勢?我會不會因為做出錯誤的決定而出局?即便不想成為先行者，同行的壓力與技術變化的速度，也會使我們不斷面對類似的更多問題。最終，我們還是得想辦法回到正確的技術軌道上來。
研究、保持使用最新技術以及直覺，都將有助于縮小這些決定的范圍，不過最終還是得在冒險一試與放棄之間做出選擇。即使有些不情愿或者也許有點晚，我們仍然擁護變革。
在消費類電子產品前沿，事情并不總是那么順理成章的。無論行業評論員的權威意見是什么，也不管他們給予怎樣
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Altium FPGA 設計工具
- 隨著軟件無線電的發展。對于濾波器的處理速度要求越來越高。傳統的FIR濾波器一般采用通用DSP處理器，但是DSP處理器采用的是串行運算，而FPGA是現場可編程陣列，可以實現專用集成電路，另外還可以采用純并行結構
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FPGA FIR 濾波器
- FPGA開發中常用到單脈沖發生器。一些文章介紹過產生單脈沖的電路，產生的單脈沖脈寬和相位都不能與時鐘同步，只能用在要求不嚴格的場合。筆者目前從事的課題中需要一個與時鐘周期等寬，相位與時鐘周期相同的鍵
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FPGA 按鍵消抖 單脈沖 發生器電路
- 大多數軟、硬件工程師都很熟悉 FPGA，這點應該勿庸置疑。這種熟悉不見得是實質性的熟悉，而是從概念上比較了解，也就是說 FPGA 功能的快速發展和成本的不斷下降是大家都不容忽略的優勢。同時，他們也認識到這種可編程器件顯然能方便地作為各種數字電路以及邏輯處理的高靈活度、低成本的載體。
基本說來，在設計方案中發揮 FPGA 的功能就是簡單地映射出所需的邏輯，然后將其下載至適當容量大小的器件中。這有些像大型處理器系統主體設計的輔助支持工作，而且在該層面上也確實發揮著自身的支持性作用。
近期一些應
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SoC FPGA
- 設計基于FPGA的8段數碼管動態顯示IP核，介紹8段數碼管內部結構及其驅動顯示方式和IP核設計方法，給出8段數碼管動態顯示IP核的Verilog HDL程序源代碼及其C語言驅動程序。此IP核可例化成1～8個共陰極(或共陽極)數碼管控制器，能方便地控制1～8個數碼管同時顯示數字和小數點位。測試結果表明，該IP核工作可靠、穩定，可直接應用于電子設計中。
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FPGA 8段數碼管 動態顯示 IP核
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