- 雖然5V電源邏輯在很多應用中仍很常見，但大多數FPGA都支持3.3V以及更低的接口電平。FPGA應用說明通常建議，當把...
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FPGA 齊納二極管
- ARM的迅速擴張是最近幾年MCU市場一道亮麗的風景線，不過迄今為止，32位在整個MCU市場占據的市場份額依舊不大，ARM核的市場份額在1/4左右。未來的走勢如何?“未來三至五年，ARM的走勢要看瑞薩”，安富利電子元件亞洲區總裁黃建雄告訴EEWORLD。
他的理由很簡單，全球單片機市場份額最大的是瑞薩，這個由原瑞薩、NEC、三菱的相關部門合并而成的巨無霸，尚未染指ARM。而全球單片機市場份額第二的飛思卡爾都在自己的專有架構之外，率先推出了基于ARMCortex-M4的產品。
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安富利 ARM
- 圖像的二維提升小波變換的FPGA實現,小波分析理論以其良好的時頻區域性和多分辨率分析能力，開辟了圖像處理的嶄新領域。小波變換是一種很好的圖像分解方法，非常適合于分析突變信號而用于靜止圖像邊緣的提取和壓縮。高階小波變化還可以用于實時處理視頻
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FPGA 實現 變換 小波 二維 提升 圖像
- 基于ARM的十回路智能配電監控單元設計,本文以內含ARM7TDMI—STM CPU的微控制器LPC2132芯片作為系統主控制器，針對電力系統數據信號的采集和數據通信，以及電力系統狀態監測為研究主題，研究設計出了一種具備智能配電，并可同時監控十個用戶回路的終端
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監控 單元 設計 配電 智能 ARM 回路 基于
- 摘要：文中分析了紅外線遙控器系統的數據編碼和傳輸機制，并用VerilogHDL語言設計了基于FPGA的紅外接收模塊硬件電路，在VCS和VirSim仿真工具中進行了仿真測試；用XilinxISE 10．1軟件進行了綜合、適配和FPGA器件下栽
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FPGA 紅外遙控 信號接收 模塊
- 引言 人們生活中的家用電器種類日益增多，遙控器的種類也隨之增加，不同種類的遙控器之間一般不能相互替代，這給人們的生活帶來諸多不便。 各類遙控器功能大致相同，大多都有數字鍵、啟動停止鍵、前進鍵、快
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遙控 家居 實現 FPGA
- 安富利公司旗下運營機構安富利電子元件亞洲主辦的安富利全球“ARM系統設計策略”研討會亞洲之旅昨天正式在北京國際會議中心拉開帷幕，共有1000名業內人士參加了此次研討會，場面盛大，與會者反響熱烈，彰顯了業界對針對ARM系統的最新設計解決方案和ARM生態系統的極大興趣和關注。北京首站后，該亞洲之旅還將陸續登陸中國的上海、深圳等7個城市，以及韓國、印度、新加坡和臺灣等亞洲不同地區的7個城市，直至8月25日結束。
安富利電子元件亞洲區總裁黃建雄先生表示：“ARM技術的
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安富利 ARM
- ARM啟動過程,ARM 啟動過程
對于一般的嵌入式系統來講，考慮到系統成本，運行速度等因素，往往聯合使用好幾種存儲器件。在下面講到的例子中，是我在開發中用到的一個 ARM9EJ 的處理器，系統中采用了SDRAM, ROM, Nand FLASH,
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過程 啟動 ARM
- IIS接口的FPGA實現,在嵌入式系統中經常采用IIS(Inter-IC Sound)總線連接專用音頻器件以實現音頻輸入輸出。不少嵌入式處理器帶有專用的通過操作特殊功能寄存器實現對外接音頻器件的操作，但也有一些嵌入式處理器沒有擴展IIS總線，如ARM7
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實現 FPGA 接口 IIS
- 摘要：電荷耦合器件(CCD)作為一種新型的光電器件，被廣泛地應用于非接觸測量。而CCD驅動設計是CCD應用的關鍵問題之一。為了克服早期CCD驅動電路體積大，設計周期長，調試困難等缺點，以線陣CCD圖像傳感器TCD1251UD為
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FPGA CCD 線陣 驅動設計
- 摘要：為了解決高速數據采集以及數據傳輸問題，設計了基于USB通信的FPGA高速數據采集系統。方案以FPGA為控制核心，實現A／D控制、數據緩存雙口RAM和控制CY7C68013A三個功能。系統采用Verilog HDL語言，通過ISE軟件編
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數據采集 系統 高速 FPGA USB 通信 基于
- ARM嵌入式的VGA接口制作,大多數嵌入式產品的顯示終端都選擇LCD，但在某些需要大屏幕顯示的應用中，工業級LCD的價格比較昂貴，且現有的大屏幕顯示器(包括CRT顯示器和LCD顯示器)一般都采用統一的15針VGA顯示接口。三星公司ARM9芯片S3C2410以其
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制作 接口 VGA 嵌入式 ARM
- 1、引言 最佳聲納系統的設計需要從聲納波形、聲納信道和聲納接收機三方面進行綜合考慮[1]。在聲納信道 ...
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ARM FPGA 聲納波形產生
- 摘要：為實現線性調頻信號的數字脈沖壓縮，設計一個FPGA硬件平臺，并著重提出一種基于FPGA IP核的脈沖壓縮設計方法。針對脈沖壓縮進行了理論分析和Matlab仿真，設計完成后對系統軟、硬件進行了全面測試，并根據實測數
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FPGA 線性調頻信號 IP核 脈沖壓縮
- 摘要：針對分辨率為1 024times;768的LCoS屏編寫了Verilog HDL驅動代碼，在quartusⅡ9．1平臺上綜合編譯，并在Altera的FPGA芯片EP3C5E14 4C8上進行了功能驗證和實際輸出信號測量。采用異步FIFO結構解決了跨異步時鐘域
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FPGA LCoS 驅動 圖像處理
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