- 鑒于互聯網訪問特性正被持續引入各種計算機和設備中，英特爾高管規劃宏偉藍圖，計劃利用其芯片設計專業知識、工廠產能、領先制造技術以及摩爾定律的經濟學，催生一類集成度更高且Web接入能力更強的全新專用系統芯片（SoC）設計和產品。英特爾還透露，前八款此類產品隸屬英特爾® EP80579 集成處理器家族，主要面向安全、存儲、通信設備以及工業用機器人等應用設計。
英特爾首次在SoC芯片設計上采用了與其現有處理器相同的英特爾架構（簡稱IA架構），基于這一架構設計的處理器主要用于互聯網內連接設備。這些
- 關鍵字：
英特爾 SoC 處理器 智能芯片
- 提要
在比較簡單的未大量使用過孔的四層或六層 PCB 上，可能很難對 LVDS 或 LVPECL 這類差分信號布線。其原因是，驅動器上的正極引腳必須驅動接收器上的相應正極引腳，而負極引腳則必須驅動接收器的負極引腳。有時跡線以錯誤的方向結束，這實際上是向電路中添加了一個倒相器。本應用指南說明 Spartan?- 3 FPGA 系列如何僅通過在接收器數據通路中加入一個倒相器即可避免大量使用過孔，并且在不要求 PCB 重新設計的情況下即可解決意外的 PCB 跡線交換問題。這項技術同樣適用于將 FPGA
- 關鍵字：
PCB LVDS 倒相器 FPGA SDR
- 1 引 言
大多數接收機必須處理動態范圍很大的信號，這需要進行增益調整，以防止過載或某級產生互調，調整解調器的工作以優化工作。在現代無線電接收裝置中。可變增益放大器是電控的，并且當接收機中使用衰減器時，他們通常都是由可變電壓控制的連續衰減器。控制應該是平滑的并且與輸入的信號能量通常成對數關系(線性分貝)。在大多數情況下，由于衰落，AGC通常用來測量輸入解調器的信號電平，并且通過反饋控制電路把信號電平控制在要求的范同內。
2 系統總體設計
在本設計中，前端TD_SCDM
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TD_SCDMA AGC FPGA RSP IIR
- 利用FPGA實現工業以太網交換機設計優化,工業以太網技術一直在進步，并越來越普及，而設計師面臨著對高性價比工業交換機日益強勁的需求。基于ASIC和ASSP的交換機因其架構固定，所以實際上沒有余地定制出新的系統特性。為了增加特性設計一般要推倒重來，此舉會導致額外的設計時間和成本支出。但如上所述的支持IEEE 1588交換機的FPGA設計可節省6到9個月的工程時間，并提供給設計師夢寐以求的靈活性，幫助他們實現精確定時協議（PTP）、 支持多個工業以太網標準、額外的標準接口或者其它可能的定制特性。
- 關鍵字：
交換機 設計 優化 以太網 工業 FPGA 實現 利用
- 引言
當今的液晶顯示(LCD) 技術在高清晰電視(HDTV) 領域得到了廣泛應用，其挑戰在于如何獲得更高的分辨率，實現更快的數據速率。提高數據速率需要專業圖像處理算法來支持快速移動的視頻。業界遇到的主要問題是：怎樣實現這些算法，率先將產品推向市場，并且能夠控制好產品功耗?
為解決這一問題，當硬件平臺和不同尺寸的LCD 顯示屏連接時，設計人員需要確定怎樣重新配置圖像處理算法。面積較大的LCD 顯示屏需要更快的數據速率，因此，難點在于怎樣根據顯示屏大小來調整數據速率。
采用新的低成本Cy
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FPGA Cyclone III LCD HDTV
- 牛津半導體，今天推出最新存儲平臺，提供數位生活方式可靠、穩健的存儲系統連接。
著眼於新興的個人共享網絡附加儲存（NAS ）市場，牛津半導體推出了高度集成的OXE810x NAS平臺，旨在橋接以太網(Ethernet)和多達兩個SATA 硬碟。該公司還推出了OXUFS936x的RAID平臺,為直接附加儲存裝置(DAS)提供至SATA數據機儲存與整合硬體RAID控制器還原裝置的通用介面(即USB2.0/FireWire/eSATA)
“推出這兩個平臺對市場及對公司都是很重要的&rd
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存儲 牛津半導體 NAS SOC
- 立體液晶顯示器是近年來新出現的虛擬現實顯示設備，它真實地再現場景的三維信息，顯示具有縱深感的圖像。其最大特點就是觀察者無需使用任何附加設備，直接用肉眼就可看到屏幕上顯示的立體圖像。觀測者可以更容易、更快速地理解真實的景深信息，更全面、更直觀地洞察圖像空間位置的實際分布狀況。
目前，國內外的自由立體液晶顯示方式通常采用計算機采集圖像并存儲，處理后輸出到液晶屏驅動電路板，然后通過板載模數轉換模塊等處理后在液晶屏顯示立體圖像。這種方式主要由計算機進行圖像采集和處理，其開發周期短，但成本較高，體積較大，
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顯示器 虛擬 液晶 FPGA
- 加州圣荷塞，2008年7月15日——全球電子設計創新領先企業Cadence設計系統公司（納斯達克: CDNS），今天宣布推出Cadence® C-to-Silicon Compiler，這是一種高階綜合產品，能夠讓設計師在創建和復用系統級芯片IP的過程中，將生產力提高10倍。C-to-Silicon Compiler中的創新技術成為溝通系統級模型之間的橋梁，它們通常是用C/C++ 和SystemC寫成的，而寄存器傳輸級（RTL）模型通常被用于檢驗、實現和集成SoC。這種
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Cadence SoC C-to-Silicon Compiler 半導體
- 本文針對FPGA實際開發過程中，出現故障后定位困難、反復修改代碼編譯時間過長、上板后故障解決無法確認的問題，提出了一種采用仿真的方法來定位、解決故障并驗證故障解決方案。可以大大的節約開發時間，提高開發效率。
FPGA近年來在越來越多的領域中應用，很多大通信系統（如通信基站等）都用其做核心數據的處理。但是過長的編譯時間，在研發過程中使得解決故障的環節非常令人頭痛。本文介紹的就是一種用仿真方法解決故障從而減少研發過程中的編譯次數，最終達到準確定位故障、縮短解決故障時間的目的。文例所用到的軟件開發平臺
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FPGA 應用仿真
- 時鐘是整個電路最重要、最特殊的信號，系統內大部分器件的動作都是在時鐘的跳變沿上進行, 這就要求時鐘信號時延差要非常小, 否則就可能造成時序邏輯狀態出錯；因而明確FPGA設計中決定系統時鐘的因素，盡量較小時鐘的延時對保證設計的穩定性有非常重要的意義。
1.1 建立時間與保持時間
建立時間（Tsu：set up time）是指在時鐘沿到來之前數據從不穩定到穩定所需的時間，如果建立的時間不滿足要求那么數據將不能在這個時鐘上升沿被穩定的打入觸發器；保持時間（Th：hold time）是指數據穩定后
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FPGA 時鐘
- 隨著嵌入式技術和通信技術的發展，二者之間已呈現出更多的融合趨勢：一方面嵌入式設備被更多地連接到互聯網上，成為互聯網接入終端；另一方面這些設備之間也越來越多地實現了互聯互通。自今年英特爾推出面向嵌入式領域的凌動處理器以來，英特爾的嵌入式市場戰略逐漸清晰，而其與終端設備芯片廠商ARM之間的競爭也成為業界關注的焦點。
7月14日，英特爾在北京舉行嵌入式戰略溝通會，英特爾公司數字企業事業部副總裁、嵌入式及通信事業部總經理DougDavis參加了會議，其在接受《中國電子報》記者采訪時表示，下一個價值數十億
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嵌入式 英特爾 SoC ARM
- Altera公司今天宣布第二季度銷售額達到3.599億美元，比2008年第一季度增長7%，比2007年第二季度增長13%。在2008年第一季度0.839億美元凈收入和每股攤薄后收益0.27美元基礎上，第二季度凈收入增長到0.98億美元，每股攤薄后收益0.32美元。和2007年第二季度相比，今年第二季度凈收入增長22%，每股攤薄后收益增長43%。
上半年運營現金流為2.268億美元。第二季度，Altera以140萬美元回購其65,000普通股。到目前為止，在第三季度，Altera已經以1004萬美
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Altera FPGA Stratix
- 0 引言
視頻采集的主流實現方案有兩種：一是基于ASIC，該方案一般采用意法、AMD等公司的專用視頻處理芯片；二是基于DSP，主要采用TI、ADI等公司的DSP信號處理器。它們作為輔處理器，可在主CPU控制下進行視頻信號的采集壓縮。隨著FPGA的發展，通過SOPC技術實現視頻采集已成為一種易于開發、設計靈活的方案。而這主要得益于IP復用技術的發展。在FPGA上構建復雜嵌入式系統可利用既有的功能模塊及其驅動程序。該方案具有更大的集成度和靈活性，因而必將成為電子設計發展的一大趨勢。
本文介紹了
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SOPC 視頻采集 DSP ASIC FPGA
- 0引 言
數控電火花(electrical discharge machining，EDM)機床是一種實現工件精密加工的特種加工工具。早期的電火花成型加工機床的脈沖電源電路是用分立元件組成，或者是用單片機來實現。分立元件電路設計復雜，電路調試困難，基于單片機或者是32位的嵌入式CPU的脈沖電源性能有了很大的提高，也具有了很高的智能性，但對于不同的處理器，其移植性不太好，而且如果硬件電路一旦完成就不能進行更改與升級。而采用現場可編程門陣列FPGA在很好的繼承單片機或者是嵌入式CPU設計的電源的優點
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FPGA 脈沖電源 EDM 數控機床 嵌入式
- 功耗關
其次，功耗更低。ARM是以低功耗和近乎福利價的IP（知識產權）授權走遍天下的。Intel的功耗不低，為此推出了多核戰略。不僅如此，今年三季度（9月10日左右），Intel將推出第一個針對嵌入式市場的芯片：SoC(系統芯片)處理器“Tolapai”。實現了兩年前的承諾：集成了北橋和南橋。Tolapai處理器基于改良版的Pentium M核心，32-bit設計，頻率600MHz、1GHz、1.2GHz，采用65nm工藝制造，集成1.48億個晶體管，封裝面積37.5×37.5mm，熱設計功耗1
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