?? 在任何高速數字電路設計中，處理噪聲和電磁干擾(EMI)都是一個必然的挑戰。處理音視頻和通信信號的數字信號處理(DSP)系統特別容易遭受這些干擾，設計時應該及早搞清楚潛在的噪聲和干擾源，并及早采取措施將這些干擾降到最小。良好的規劃將減少調試階段中的大量時間和工作的反復，從而會節省總的設計時間和成本。
如今，最快的DSP的內部時鐘速率高達數千兆赫，而發射和接收信號的頻率高達幾百兆赫。這些高速開關信號將會產生大量的噪聲和干擾，將影響系統性能并產生電平很高的EMI。而DSP系統也
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DSP 視頻系統 噪聲 電磁干擾 EMI
引 言
密碼模塊是指被容納在加密邊界范圍中，執行認可安全功能(包括加密算法與密鑰產生)的硬件、軟件和固件的組合。集加密存儲、安全認證等功能于一體的USB密碼模塊，可作為USB安全鑰載體、USB加密卡、USB大容量加密存儲體應用于保護信息系統和秘密信息的主要工具，具有十分良好的市場應用背景。
SOPC(System On a Programmable Chip)技術是一種靈活、高效的軟硬件綜合解決方案。硬件上可裁剪、可擴充、可升級，有豐富的IP核可供集成，使得設計變得十分靈活。
本文提
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SOPC USB 密碼模塊 嵌入式 控制器 NiosII MCU 固件
引 言
視頻監控系統的設計方案有很多種，但是市場產品的主流一般選擇兩種方案：一是基于CPU和專用的視頻編解碼ASIC芯片。該方案選擇以ARM為核心的CPU和專用媒體處理芯片搭建。優點是開發時間相對較短，但由于采用ASIC，靈活性較差，產品一旦定型，很難更改。二是采用面向媒體處理的專用DSP。其開發時間不長，優點是由于算法是軟件代碼，所以可以不斷對產品性能進行升級，重復開發成本較低。由全球最大的DSP制造商德州儀器（TI）推出的TMS320DM642（以下簡稱DM642）作為一款高性價比、專用于多
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多媒體 處理器 視頻監控 ASIC CPU DSP CCS DM642
介紹了以ARM+DSP體系結構為基礎的FPGA實現。在其上驗證應用算法，實現了由ARM負責對整個程序的控制，由DSP負責對整個程序的計算，最大程度地同時發揮了ARM和DSP的各自優勢。
ARM通用CPU及其開發平臺，是近年來較為流行的開發平臺之一，而由ARM+DSP的雙核體系結構，更有其獨特的功能特點：由ARM完成整個體系的控制和流程操作，由DSP完成具體的算法和計算處理。這樣，不但可以充分地發揮ARM方便的控制優勢，同時又能最大限度地發揮DSP的計算功能。這在業界已逐漸成為一種趨勢。
本
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ARM DSP FPGA 軟硬件協同驗證 SoC
提出了一種使用視頻A/D芯片TLC5510與低檔DSP芯片TMS320F206實現圖像采集的接口設計方案，同時給出了接口程序，為低檔DSP芯片提供了一條新的應用途徑。
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采集卡 設計 圖像 DSP TMS320F206 基于
飛思卡爾半導體近日在其陣容日益壯大的16位汽車微控制器（MCU）系列中又推出新品，新產品建立在已在市場上大獲成功的S12內核之上。先進的S12P系列是飛思卡爾最新的16位MCU，具有集成的微控制器局域網（CAN）功能，縮短了汽車市場的8位和16位器件之間的距離。
MC9S12P系列具有16位MCU的出色性能優勢，同時保留了8位MCU的入門級定價、低功耗、電磁兼容性（EMC）和代碼規模效率等優點。S12P系列非常適合于大量中央車身控制應用，如電動門窗、座位控制器、遮陽頂棚、車門模塊、低端防抱死系統
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飛思卡爾 微控制器 排放控制 MCU
汽車作為一部大型的機電一體化設備，汽車電子在汽車整體成本中的比例越來越大。目前歐美發達國家汽車電子的平均成本達350美元以上，其涵蓋了從車身控制、動力傳動、車身安全，到車內娛樂的各個方面。
微控制器（MCU）作為汽車電子系統內部運算和處理的核心，也遍布懸掛、氣囊、門控和音響等幾十種次系統（Sub-System）中。由于汽車作為高速交通工具承載了對用戶生命安全的保障，同時汽車經常工作在十分惡劣的環境中，其對內部電子設備的可靠性要求要遠高于一般性電子產品。因此汽車電子所用的MCU與一般性產品的結構差
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汽車電子 MCU CAN LIN 系統總線 嵌入式 閃存 DSP
為了減少引發溫室效應及全球變暖的汽車排放問題，飛思卡爾半導體現已在32位汽車微控制器（MCU）系列中引入集成的排放控制技術。與飛思卡爾其它動力總成微控制器類似，這些MCU幫助減少二氧化碳廢氣，為新興市場提供經濟高效且精密的引擎控制設計。
MPC563xM系列包括3個32位動力總成MCU，用以改善擁有一至四個氣缸的小型引擎的效率和性能。MPC563xM器件基于Power Architecture™技術，不但增強了動力總成的功能，如片上排放控制等，而且還滿足了引擎和變速箱供應商的成本限制
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飛思卡爾 微控制器 排放控制 MCU
本文介紹了一種基于FPGA和DSP的多通道音頻采集卡的設計和實現方案，該卡能夠工作在多種采樣率下并可以使用DSP中不同的音頻算法用于滿足不同場合，并通過PC104接口將處理后的數據上傳至主機。
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采集卡 實現 音頻 DSP FPGA 基于
摘 要: 本文分析了目前8位微控制器的更新和設計趨勢，主要討論其RISC體系架構的產品設計，并重點從體系架構的角度出發，就高性能、低功耗兩方面對在設計中采用的關鍵技術進行了探討研究。
關鍵詞： RISC；微控制器；低功耗；流水線
1．引言
微控制器(Microcontroller)自上世紀70年代出現以來，在將近30年的時間里得到了迅猛的發展和廣泛的應用。隨著微電子技術的飛速發展，微控制器以其性能好、體積小、價格優、功能齊全等突出優點被廣泛應用于家
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微控制器 RISC 低功耗 流水線 MCU
多目標建模是一種電子控制單元(ECU)開發技術，它采用了基于模型的設計方法和自動嵌入式代碼生成技術。利用多目標建模技術可以為各種嵌入式DSP、微處理器和微控制器建立算術模型，并實現代碼的自動生成。軟件開發人員也因此可以節省許多時間和精力，因為他們不再需要為每個嵌入式目標器件編寫、測試和重編代碼。
在這方面，Visteon公司正在使用多目標建模技術開發動力控制系統。他們的方法以數據字典的創建為基礎，而數據字典用來控制模型仿真和嵌入式代碼生成時使用的數據類型。利用這種方法可以仿真設計思路
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ECU 多目標建模 嵌入式 DSP 微處理器 微控制器
車載娛樂系統的技術發展趨勢正在變得日益復雜，通過銅纜發送音頻數據的簡單音頻系統已經成為過去。為了滿足多通道音頻處理和分布式視頻的要求，復雜的網絡處理變得越來越流行。特別是與數字傳輸內容保護(DTCP)加密和解密方法相關的面向媒體的系統傳輸(MOST)光網絡正在被許多高擋和中檔汽車采用，這種趨勢以及車載音頻系統通常必須以變化的采樣頻率適應多種輸入源(調幅和調頻、CD、DVD、蜂窩電話和導航系統輸入)這個事實給數字信號處理器(DSP)供應商增加了壓力，要求他們提供增強性能和更高集成度的處理器。
基于
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DSP 車載娛樂 MOST 音頻 Visual Audio
全球可編程邏輯解決方案領導廠商賽靈思公司（ Xilinx, Inc. (NASDAQ: XLNX) ）今天宣布其屢獲殊榮的65nm Virtex-5 SXT FPGA平臺新增針對高性能數字信號處理（DSP）而優化的Virtex™-5 SXT240T器件。該器件高達528GMACs的乘法累加性能和超過190 GFLOPS的單精度浮點DSP性能，為廣播視頻、醫療成像、無線通信、國防和高性能計算等應用的開發人員提供了全球性能最高的可配置DSP解決方案。
“支持高分辨率（HD）視
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Xilinx DSP 賽靈思 廣播視頻 醫療成像 無線通信 國防 高性能計算 IP內核
近年來，DSP在SVPWM(空間矢量脈寬調制)控制領域得到了廣泛應用。
但是使用DSP單核心的控制方法仍然存在一些缺陷：基于軟件的：DSP在實現SVPWM觸發信號時需要較長的時鐘周期；微處理器中不確定的中斷響應會導致PWM脈沖的相位抖動。針對以上問題，本文提出了一種利用FPGA實現的SVPWM信號發生器，系統結構如圖1所示。作為DSP的外圍接口電路，該信號發生器能夠屏蔽DSP內部錯誤中斷對輸入時間信號的影響，保證輸出完整的SVPWM觸發信號波形，其三相并行處理結構還能夠有效提升系統的動態響應速度
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DSP SVPWM VHDL 信號發生器
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