- 引言
NiosII是一個嵌入式軟核處理器，除了可以根據需要任意添加已經提供的各種外設以外，用戶還可以通過定制自定義外設和自定義指令的方式來滿足各種應用需求。定制用戶外設和用戶指令是使用NiosII嵌入式軟核處理器的重要特征。定制的用戶外設能夠以“硬件加速器”的形式實現各種各樣用戶要求的功能;同時定制的用戶指令，可以把一個復雜的標準指令序列簡化為一條用硬件實現的單個指令，以增強對實時軟件算法的處理能力。近來，隨著國內SOPC開發的逐步深入，這兩者的性能開始成為一個關注的焦點。本文通過CRC32對S
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嵌入式系統 單片機 SOPC 自定義指令 SoC ASIC
- Cadence設計系統公司與領先的ASIC和硅智產(SIP)無晶圓IC設計公司智原科技宣布智原已經采用Cadence® VoltageStorm® 功率分析技術進行低功耗簽收，并支持智原的尖端低功耗設計。智原使用VoltageStorm的靜態和動態功率分析檢驗其高級低功耗設計技術，包括功率門控、去耦合電容優化和多電源多電壓(MSMV)規劃。
智原有一套現成的功率分析解決方案，目前已經成功發展到90納米級別。不過由于意識到了65納米及以下級別低功耗簽收帶來的新技術挑戰，智原對目前市
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嵌入式系統 單片機 Cadence IC ASIC MCU和嵌入式微處理器
- 系統闡述了USB1.1 OHCI 主機控制器IP 的功能、結構、各功能模塊的電路設計和實現方法，介紹了主機串行接口引擎模塊及其時鐘和數據恢復電路以及并行CRC 算法的設計。
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IP 設計 控制器 主機 SoC USB1.1OHCI 中科
- 在新的系統級芯片(SoC)設計中，尤其是對便攜式設備而言，對整個系統功耗的優化正變得與性能和面積優化同樣重要。有些EDA工具具有門控時鐘、降壓、降頻和減少漏電電流等功能，有些芯片制造商能夠提供低功耗庫和工藝，所有這些工藝都非常費時;在最好情況下能夠提供兩倍的性能提升，因為這些提升是在設計周期的后端進行的。
功耗優化的最佳時間是在設計周期的一開始進行，即在確定體系結構的系統級進行優化。確定系統級體系結構對功耗影響非常大，如局部存儲器和高速緩存的數量和容量。在設計周期的一開始進行優化可以減少功耗十倍
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嵌入式系統 單片機 存儲器 SoC SoC ASIC
- 因iPOD/iPhone/PDA這類時尚新型PortableDevice產品的流行，帶動了消費者新的應用需求，對USBAudio播放器平臺要求整合更多的功能與較佳音質播放。針對這股對USBAudio播放器平臺產品開發的需求與多元應用，普誠科技(PrincetonTechnology)推出了目前最完整的解決方案控制芯片-USB揚聲器控制芯片PT8915。
PT8915的單芯片純硬件設計架構，有效整合音量控制鍵與Line-In(模擬音頻輸入)的功能，更使得PT8915能支持Hybrid-Audio(
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嵌入式系統 單片機 普誠科技 USB PT8915 SoC ASIC
- 賽靈思公司宣布，其90nm和65nm器件的銷售在亞太地區創紀錄營收的大力推動下，創造了一個新的紀錄。賽靈思90nm和65nm器件在消費和通信領域的廣泛應用，是促使其收獲此次強勁增長的主要原因。在2008財年9月結束的第二個財季里，這些產品在亞太區的銷售比2006財年的同一季度增長了近五倍。賽靈思預計其90nm和65nm產品在PLD市場的累積市場份額已經接近70%。
"隨著亞洲客戶越來越多地采用賽靈思解決方案來滿足他們在技術和上市時間上的要求，賽靈思的90nm和65nm產品贏得的設計數量也不斷地創
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嵌入式系統 單片機 賽靈思 PLD ASIC 嵌入式
- 全面線路保護方案供應商Semitel繼半導體ESD全面保護方案之后，結合新材料和多層印制線路板技術，推出了超低電容的高分子ESD的專利產品。目前其產品的電容值最低已經能做到0.15pF，完全適合超高速傳輸的應用場合。
在需要超高速傳輸信號的場合，如高清晰多媒體接口(HDMI),數字影像接口(DVI),USB2.0接口，手機天線等，其傳輸速率多在3Gbps以上，當保護器件的電容大于1pF時，其寄生電容會對信號的傳輸造成非常大的影響。采用傳統的半導體工藝制作的半導體ESD保護元件，其電容一般都在幾個
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模擬技術 電源技術 Semitel 電子 ESD SoC ASIC
- 進一步提升低功耗技術
音視潮公司針對數字信號處理(DSP)應用提供可配置IP解決方案。提供的產品包括面向特殊應用而進行優化配置的高性能核，以及工程師們可在復雜的SoC上對音視潮的IP快速地進行驗證及自定義設置的工具組件。一套完整的解決方案包含了一些必需的接口和外圍設備，以實現將高性能、低功耗的DSP成功嵌入終端產品中。
音視潮公司可以提供三個系列的預構型解決方案或平臺：一是面向通用DSP的Jazz DSP解決方案;二是主要面向VoIP應用的Jazz Voice解決方案;三是面向音頻、視頻及
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嵌入式系統 單片機 數字信號處理 DSP IP MCU和嵌入式微處理器
- SOPC一詞主要是源自Altera, 其涵義是因為目前CPLD/FPGA的容量愈來愈大, 性能愈來愈好, 加上價格下跌的推波助瀾之下, 以往ASIC產品才能具有的 SoC觀念, 也能移植到CPLD/FPGA上, 并且因為CPLD/FPGA的可編程(Programmable)能力, 使得CPLD/FPGA不僅能實現一個高復難度的系統, 而且還能快速改變系統的特性. 類似的觀念也鑒于Xilinx的Platfor
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SOPC CPLD FPGA SoC ASIC
- 僅僅兩天，日本運營商部署中國TD-SCDMA的事情，就以日本運營商IPMobile申請破產而閃電收場。
前日晚，來自日本共同網的消息稱，10月30日上午日本IPMobile公司召開董事會，認定公司無法繼續經營而將經營執照歸還給日本總務省，并于當天向東京地方法院提出了破產申請。
電信專家李進良對這一突發消息感到吃驚，他表示，要使TD-SCDMA快速地、成功地走向國際，首先必須要保證其在中國市場迅速成功，否則很難想象一個技術標準在國內市場都不能得到壓倒性的應用和認可，卻在走向國際市場的時候，得
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- 摘要 下一代固定和移動電話網體系結構將建立在全IP的基礎上，從某種意義上說，它將是一種可編程的、基于IP的網絡，這必然要求下一代網絡為應用開發提供強大的、方便的、定義明確的API。文章首先介紹了全IP下一代網絡的API體系結構，描述了系統構件智能化程度的演變趨勢，給出了下一代網絡的分層結構與功能結構。
1、引言
人們逐漸認識到，下一代固定和移動電話網體系結構將建立在IP的基礎上。提出全IP網絡[1-3]的首要動機是由于目前它是支持絕大多數創新性和贏利業務的最佳體系結構選擇。提出全IP網絡的
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通訊 無線 網絡 IP 網絡體系結構 通信基礎
- 1 概述
數字攝像機的最大特點在于信號數字化。它由成像芯片CCD將靜止或活動的圖像分解成像素，并轉換成電信號。這些信號由數字攝像機內的數字信號轉換器轉換成數字信號，再經微處理器進行圖像處理和數據壓縮編碼后送到內部或外部存儲器，同時也可送到LCD/TV顯示屏。
存儲器中的數字信息通過接口輸入電腦再變成圖像。借助于CPU所提供的圖像處理軟件，按人們意愿進行加工、編輯等處理，然后由彩色打印機制成一張理想的圖像。更重要的是，數字委員會還能通過電腦網絡傳到世界各地。
與模擬攝像機相比較，數字攝
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嵌入式系統 單片 數字攝像機 LCD/TV CCD SoC ASIC
- Tensilica公司日前聯合Chip Estimate公司宣布，Tensilica加入Chip Estimate主要IP核合作伙伴計劃。身為主要IP核合作伙伴，Tensilica公司在通過ChipEstimate.com使得客戶可以集中以訪問其標準系列處理器IP核和可配置處理器技術的信息。Tensilica公司針對片上系統(SoC)設計的IP核解決方案令設計工程師能夠創造出低功耗、高性能的軟硬件集成電路產品。
ChipEstimate.com自2005年開始運作，為電子設計和半導體設計公司提供
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- IAR Systems發布TCP/IP協議棧，配套使用于IAR PowerPac™ RTOS，為使用IAR Embedded Workbench® for ARM集成開發環境的開發者提供了一個簡便易用的TCP/IP協議。它特別適用于需要與電腦網絡(比如Internet)方便連接的便攜式產品開發。
有了TCP/IP協議模塊，IAR PowerPac就包括了把全套的TCP/IP協議移植到ARM芯片上的所有必要組件。IAR PowerPac TCP/IP協議在運行時可配置，適用于帶
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- 處理器是1款系統的心臟部分，所有功能的達成幾乎都要依靠處理器，而在嵌入式系統方面，由于針對的應用層次較為較為狹窄，因此更要在效能、功耗與成本等變量進行多方考慮，其中，授權方案更是影響到廠商進行開發時的成本與產品上市時程，因此更需要審慎面對。
在各種嵌入式應用當中，總缺不了1或多個處理器核心來統籌整個系統的運作，但是處理器核心的架構復雜，相關的設計概念必須有多年累積的技術實力才有辦法實現，以目前生產代工型態至上的企業觀念中，自力進行處理器的開發不啻是吃力又不討好的工作，不僅無法帶來立即的營收，開發
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