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低功耗 文章 最新資訊

AD7416在低功耗系統(tǒng)中的應(yīng)用

  • 0 引言
    在測(cè)量與儀器儀表中,溫度的檢測(cè)幾乎成為必不可少的一部分。傳統(tǒng)的模擬溫度傳感器或是外圍電路復(fù)雜,或是需要設(shè)計(jì)A/D轉(zhuǎn)換、操作煩瑣,在使用上都受到一定的限制,用數(shù)字溫度傳感器AD7416設(shè)計(jì)各種控制系
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隨鉆測(cè)井系統(tǒng)井下的設(shè)計(jì)

  • 提出了隨鉆測(cè)井系統(tǒng)井下傳感器的一種低功耗設(shè)計(jì)方法。介紹了隨鉆測(cè)井系統(tǒng),其需要在井下長(zhǎng)時(shí)間工作且只能通過電池供電的特殊性,決定了低功耗設(shè)計(jì)是整個(gè)系統(tǒng)設(shè)計(jì)的核心問題。本文通過對(duì)低功耗電路設(shè)計(jì)原則的分析,結(jié)合隨鉆測(cè)井系統(tǒng)的要求,采用Freescale公司的MC9S12Q128單片機(jī),在硬件和軟件兩個(gè)方面對(duì)隨鉆測(cè)井系統(tǒng)井下傳感器進(jìn)行了低功耗設(shè)計(jì),采用低功率器件和動(dòng)態(tài)功耗分配的省電管理模式。
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MSP430單片機(jī)在測(cè)試系統(tǒng)中的應(yīng)用

  • 1 引言
    單片機(jī)(或微控制器)技術(shù)已滲透到生活的方方面面,廣泛應(yīng)用于家用電器、通信、測(cè)試等領(lǐng)域。因此該技術(shù)正積極影響著人們的生活。這里給出一種基于MSP430單片機(jī)的測(cè)試系統(tǒng)設(shè)計(jì)。MSP430系列單片機(jī)是TI公司生
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Cache結(jié)構(gòu)的低功耗可重構(gòu)技術(shù)研究

  • 在分析Cache性能的基礎(chǔ)上介紹了當(dāng)前低功耗Cache的設(shè)計(jì)方法,提出了一種可重構(gòu)Cache模型和動(dòng)態(tài)可重構(gòu)算法。Cache模型能夠在程序運(yùn)行過程中改變相聯(lián)度和大小,動(dòng)態(tài)可重構(gòu)算法能夠在運(yùn)行時(shí)針對(duì)不同的應(yīng)用程序?qū)芍貥?gòu)Cache進(jìn)行配置。通過對(duì)Cache的動(dòng)態(tài)配置,不僅可以提高Cache命中率,還能夠有效降低處理器的功耗。
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ST發(fā)布基于超低功耗技術(shù)平臺(tái)的8位微控制器

  •   世界領(lǐng)先的微控制器廠商意法半導(dǎo)體宣布,首批整合其高性能8位架構(gòu)和最近發(fā)布的超低功耗創(chuàng)新技術(shù)的8位微控制器開始量產(chǎn)。以節(jié)省運(yùn)行和待機(jī)功耗為特色,STM8L系列下設(shè)三個(gè)產(chǎn)品線,共計(jì)26款產(chǎn)品,涵蓋多種高性能和多功能應(yīng)用。   設(shè)計(jì)工程師利用全新的STM8L系列可提高終端產(chǎn)品的性能和功能,同時(shí)還能滿足以市場(chǎng)為導(dǎo)向的需求,例如,終端用戶對(duì)節(jié)能環(huán)保產(chǎn)品的需求,便攜設(shè)備、各種醫(yī)療設(shè)備、工業(yè)設(shè)備、電子計(jì)量設(shè)備、感應(yīng)或安保設(shè)備對(duì)電池使用周期的要求。設(shè)計(jì)人員將選擇STM8L這類超低功耗的微控制器,以符合低功耗產(chǎn)品設(shè)計(jì)
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Cadence低功耗解決方案納入PowerMagic低功耗設(shè)計(jì)方法中

  •   全球電子設(shè)計(jì)創(chuàng)新領(lǐng)導(dǎo)廠商Cadence益華電腦今天宣布,創(chuàng)意電子(Global Unichip Corporation,GUC)將以CPF為基礎(chǔ)的Cadence低功耗解決方案,整合至其PowerMagic設(shè)計(jì)方法中,協(xié)助客戶將復(fù)雜的低功耗ASIC設(shè)計(jì)實(shí)現(xiàn)最佳化。   創(chuàng)意電子在PowerMagicTM設(shè)計(jì)方法,針對(duì)ASIC設(shè)計(jì)驗(yàn)證與實(shí)現(xiàn),整合Cadence®低功耗解決方案 (包括Cadence Encounter® RTL Compiler、Encounter 數(shù)位設(shè)計(jì)實(shí)現(xiàn)系統(tǒng)(ED
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時(shí)鐘產(chǎn)品分類

  •   時(shí)鐘按功能分,可分為多頻、EMI削減、低功耗小尺寸、高性能低相位抖動(dòng)、時(shí)鐘分配等(如圖1)。   多頻:就是在同一個(gè)晶振里可產(chǎn)生不同頻率的時(shí)鐘源。例如,晶振本身也許是一個(gè)37kHz的,你可以從這個(gè)頻率上面去延伸開來,像ATM需要25MHz,SDH需要19.44MHz……這一個(gè)器件可產(chǎn)生系統(tǒng)里需要的所有頻率,并且這些頻率之間可以相互沒有任何關(guān)系。   EMI削減:該器件已擁有多頻器件的所有功能,除此之外,EMI(電磁干擾)削減特點(diǎn)突出。   低功耗、小尺寸:主要針對(duì)
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簡(jiǎn)易USB與LVDS接口轉(zhuǎn)換器

  • 1 引言
    通用串行總線USB(Universal Serial Bus)接口以其通信速率快,USB2.0協(xié)議速率達(dá)480 Mb/s,支持熱插拔的特點(diǎn)得到廣泛應(yīng)用,緩解日益增加的PC外設(shè)與有限的主板插槽和端口之間的矛盾;而低壓差分信號(hào)LVDS(
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基于MAX16024的低功耗設(shè)備電源備份方案

  • 1 引言
    在低功耗設(shè)備中,供電穩(wěn)定性是影響設(shè)備性能的關(guān)鍵因素之一,高效的電源備份系統(tǒng)可為低功耗設(shè)備提供穩(wěn)定的電源管理性能和靈活的供電配置選擇。因此,這里提出一種基于MAX16024的低功耗設(shè)備電源備份方案。
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基于嵌基于μC/OS-II嵌入式實(shí)時(shí)操作系統(tǒng)的低功耗開發(fā)

  • 基于嵌基于μC/OS-II嵌入式實(shí)時(shí)操作系統(tǒng)的低功耗開發(fā), 隨著嵌入式系統(tǒng)應(yīng)用的日益廣泛,如何實(shí)現(xiàn)嵌入式系統(tǒng)的低功耗開發(fā)已經(jīng)成為嵌入式應(yīng)用發(fā)展的關(guān)鍵技術(shù)之一,是近幾年來人們?cè)谇度胧较到y(tǒng)的設(shè)計(jì)中普遍關(guān)注的難點(diǎn)與熱點(diǎn)。嵌入式系統(tǒng)正被廣泛應(yīng)用于移動(dòng)性較強(qiáng)的產(chǎn)品中去
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CSR中的磁鐵溫度測(cè)控系統(tǒng)的設(shè)計(jì)

  • 引言
    HIFRL-CSR中磁場(chǎng)的作用是約束離子行為,帶電粒子束在磁場(chǎng)中聚焦和傳輸,磁場(chǎng)性能的好壞直接影響到束流的品質(zhì),而磁鐵溫度又影響著磁場(chǎng)的安全性能。在加速器控制系統(tǒng)中,放置在CSR主環(huán)的磁鐵多達(dá)40多個(gè),要對(duì)其
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一個(gè)用于流水線模數(shù)轉(zhuǎn)換器的高精度、低功耗采樣保

  • 介紹了一個(gè)用于高精度模數(shù)轉(zhuǎn)換器,采用0.25μmCMOS工藝的高性能采樣保持電路。該采樣保持電路的采樣頻率為20MHz,允許最大采樣信號(hào)頻率為10MHz,在電源電壓為2.5V的情況下,采樣信號(hào)全差分幅度為2V。通過采用全差分flip-around結(jié)構(gòu),而非傳統(tǒng)的電荷傳輸構(gòu)架,因而在同等精度下,大大降低了功耗。為了提高信噪比,采用自舉開關(guān)。Hspice仿真結(jié)構(gòu)顯示:在輸入信號(hào)為5MHz的情況下,無雜散動(dòng)態(tài)范圍(SFDR)為92.4dB.該電路將被用于一個(gè)14位20MHz流水線模數(shù)轉(zhuǎn)換器。
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基于O.18μm CMOS工藝的寬帶LCVCO設(shè)計(jì)

  • 引言
    壓控振蕩器(VCO,Voltage-Controlled Oscilla-tor)作為射頻集成電路中的一個(gè)關(guān)鍵性部件,隨著無線技術(shù)的快速發(fā)展而必須滿足新的性能要求。目前,無線收發(fā)機(jī)發(fā)展的方向之一就是兼容兩個(gè)或多個(gè)通信頻段。即要
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微捷碼宣布推出65納米低功耗工藝的參考流程

  •   芯片設(shè)計(jì)解決方案供應(yīng)商微捷碼(Magma®)設(shè)計(jì)自動(dòng)化有限公司日前宣布,一款支持新加坡特許半導(dǎo)體制造公司新一代增強(qiáng)的65納米低功耗工藝的基于Common Platform技術(shù)、基于Talus®的低功耗RTL-to-GDSII集成電路(IC)設(shè)計(jì)流程正式面市。這項(xiàng)增強(qiáng)的65納米低功耗工藝被簡(jiǎn)稱為65nm LPe;它通過利用創(chuàng)新性減少漏電技術(shù),可顯著降低高達(dá)50%的片上系統(tǒng)(SoC)待機(jī)功耗。   基于微捷碼Talus IC實(shí)現(xiàn)系統(tǒng),這款支持Chartered 65LPe的低功耗參考流程
  • 關(guān)鍵字: Magma  Talus  65納米  低功耗  
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低功耗 介紹

如果用實(shí)實(shí)在在的詞語來表達(dá),那就是:這些特點(diǎn)減少了一個(gè)終端系統(tǒng)的總功耗,而這反過來又有望降低我們對(duì)于化石燃料的依賴。由于可以將較低的功耗直接視為等同于所需電力的減少,因此使得上述目標(biāo)得以實(shí)現(xiàn)。而且,較少的電力消耗首先意味著產(chǎn)生電能所需的化石燃料的減少。相應(yīng)地,這將有助于減少對(duì)于我們所居住星球的大氣和氣候具有負(fù)面影響的溫室氣體。   為了進(jìn)一步說明這一點(diǎn),考慮一下,美國每年總耗電量大約為 4 萬億 [ 查看詳細(xì) ]

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