用本系統實現FSK調制結構框圖如圖4所示，用Verilog-HDL語言編寫實現的FSK調制模塊，相對于傳統軟件無線電的實現方式，省去了讀取指令周期的時間，總運算時間縮短了一半。FSK調制的ModelSim波形仿真結果如圖5所示。

　　3 結 論

　　改進的基于FPGA的嵌入式軟件無線電系統，可更好地滿足通信、雷達、數字電視等高科技領域對信號處理實時性的要求。運用軟件無線電和SoPC技術，極大的提高了系統動態實時信號的處理能力。在節約資源方面，以節省芯片數量計算，該系統相對于目前常規系統，節省功耗和體積可達30%以上。40MHZ時鐘頻率, 12bit精度，80dB無寄生動態范圍，該系統可以應用于Cellular / PCS基站，多通道多模式接收機，GPS抗干擾接收機，相控陣接收機，頻譜分析，3G無線通信等領域。

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